El grupo de trabajo del Laboratorio de Telecomunicaciones desarrolla investigación básica y aplicada que tiene que ver con el diseño y modelado de circuitos y sistemas para telecomunicaciones. También se estudia lo relativo a sistemas embebidos, y cómputo reconfigurable con tarjetas de desarrollo de sistemas digitales, DSP-FPGA.
Entre el equipo más notable se tiene:
Las temáticas de interés del grupo de investigadores están relacionadas con el modelado y diseño de circuitos y sistemas digitales y analógicos, radiofrecuencias (RF) y microondas, sistemas caóticos, sistemas de seguridad implementación en FPGA y DSP, entre otras.
Dr. José Cruz Núñez Pérez
Responsable del laboratorio e investigador
Doctor en Ciencias de Telecomunicaciones
Sistema Nacional de Investigadoras e Investigadores, nivel II
jnunez@ipn.mx
Dr. Roberto Herrera Charles
Investigador
Doctor en Ciencias de la Computación
rherrerac@ipn.mx
M. en C. Andrés Calvillo Téllez
Investigador
Maestro en Ciencias en Sistemas Digitales
calvillo@ipn.mx
Estudiantes de Doctorado
O. Afolabi
R. Almada
Estudiantes de Maestría
J. Castro
C. Ornelas
A. Almanza
El quehacer científico está centrado en la generación de conocimiento básico y aplicado que se logra a través de la realización de proyectos de investigación, llevado a cabo por un grupo de investigadores especialistas en la materia.
Nombre del proyecto | Periodo | Fuente |
Optimización en FPGA de sistemas caóticos de orden fraccional basados en dispositivos con memoria y encriptación de imágenes | 2025 | SIP-IPN |
Sistema hidropónico sostenible IoT alimentado con energía solar fotovoltaica | 2025 | SIP-IPN |
Encriptación de imágenes usando osciladores caóticos de orden fraccional y basados en dispositivos con memoria. | 2024 | SIP-IPN |
Aplicación del ecosistema WoT a la agroecología. | 2024 | SIP-IPN |
Prototipo de satélite CanSat: Un Enfoque Interdisciplinario en Educación STEM | 2024 | SIP-IPN |
Implementación de FPGA de sistemas caóticos basados en dispositivos con memoria, memristor, memcapacitor y meminductor. | 2023 | SIP-IPN |
Aplicación de la plataforma experimental WoT. | 2023 | SIP-IPN |
Sistema digital para medición del estado de salud de celdas para la recuperación de las baterías de autos eléctricos. | 2023 | SIP-IPN |
A continuación, se presenta un listado de la productividad científica más reciente lograda por el grupo de trabajo.
FPGA Implementation of Secure Image Transmission System Using 4D and 5D Fractional-Order Memristive Chaotic Oscillators.
J.-C. Núñez-Pérez, O.-M. Afolabi, V.-A. Adeyemi, Y. Sandoval-Ibarra, E. Tlelo-Cuautle. 2025.
FPGA realization of a fractional-order model of universal memory elements.
Opeyemi-Micheal Afolabi, Vincent-Ademola Adeyemi, Esteban Tlelo-Cuautle, José Cruz Núñez-Pérez. 2024.
FPGA realization of an image encryption system using a 16-cpsk modulation technique.
José Cruz Núñez-Pérez, Vincent Ademola Adeyemi, Yuma Sandoval-Ibarra, F. Javier Pérez-Pinal, Esteban Tlelo-Cuautle. 2024.
FPGA realization of an image encryption system using the DCSK-CDMA technique.
Miguel-Angel Estudillo-Valdez, Vincent-Ademola Adeyemi, Jose-Cruz Nuñez-Perez. 2024.
FPGA implementation of parameter-switching scheme to stabilize chaos in fractional spherical systems and usage in secure image.
Adeyemi, V.-A.; Tlelo-Cuautle, E.; Sandoval-Ibarra, Y.; Nuñez-Perez, J.-C. 2023.
Fractional PID controller for voltage-lift converters.
Martinez-Patiño, L.M.; Perez-Pinal, F.J.; Soriano-Sánchez, A.G.; Rico-Secades, M.; Zarate-Orduño, C.; Nuñez-Perez, J.-C. 2023.
INSTITUTO POLITÉCNICO NACIONAL
D.R. Instituto Politécnico Nacional (IPN). Av. Luis Enrique Erro S/N, Unidad Profesional Adolfo López Mateos, Zacatenco, Alcaldía Gustavo A. Madero, C.P. 07738, Ciudad de México. Conmutador: 55 57 29 60 00 / 55 57 29 63 00.
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